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崗位職責(zé)： 1、 根據(jù)項(xiàng)目需求和系統(tǒng)設(shè)計(jì)方案，制定邏輯設(shè)計(jì)方案，包含總體架構(gòu)、模塊劃分、接口定義、資源評(píng)估、功耗評(píng)估及 FPGA 芯片選型; 2、 負(fù)責(zé)產(chǎn)品具體邏輯設(shè)計(jì)工作，包括 FPGA 代碼開(kāi)發(fā)，仿真驗(yàn)證和時(shí)序設(shè)計(jì)，資源優(yōu)化，時(shí)序優(yōu)化; 3、 負(fù)責(zé)常用 ADC、DAC、時(shí)鐘等芯片的開(kāi)發(fā)測(cè)試，根據(jù)項(xiàng)目要求輸出寄存器配置，接口代碼的開(kāi)發(fā)和測(cè)試; 4、 負(fù)責(zé)常用低速接口的開(kāi)發(fā)測(cè)試，包括串口，SPI、IIC、LVDS 等接口開(kāi)發(fā)測(cè)試； 5、 負(fù)責(zé)項(xiàng)目中鏈路的信號(hào)處理實(shí)現(xiàn)仿真驗(yàn)證，如 DDC，DUC，DBF 等，和算法工程師一起完成算法部分的移植對(duì)接測(cè)試驗(yàn)證等工作; 6、 負(fù)責(zé)項(xiàng)目產(chǎn)品調(diào)試，測(cè)試，分析解決項(xiàng)目開(kāi)發(fā)中遇到的問(wèn)題，配合完成系統(tǒng)聯(lián)調(diào)聯(lián)測(cè)； 7、 配合硬件和軟件工程師，分析排查解決定位項(xiàng)目中遇到的相關(guān)問(wèn)題; 8、 負(fù)責(zé)設(shè)計(jì)文檔、調(diào)試文檔、測(cè)試文檔等相關(guān)的編寫(xiě)。 任職要求： 1、 學(xué)歷：本科及以上；無(wú)線(xiàn)電、電子、通信、計(jì)算機(jī)相關(guān)專(zhuān)業(yè)； 2、 經(jīng)驗(yàn)：本科5年以上，碩士3年以上的FPGA設(shè)計(jì)經(jīng)驗(yàn)和實(shí)際硬件調(diào)試經(jīng)驗(yàn)；有大型FPGA開(kāi)發(fā)項(xiàng)目經(jīng)驗(yàn)的優(yōu)先，有數(shù)字相控陣開(kāi)發(fā)經(jīng)驗(yàn)的優(yōu)先，具有高速FPGA系統(tǒng)和高速FPGA接口設(shè)計(jì)經(jīng)驗(yàn)，具有FPGA各類(lèi)接口和數(shù)據(jù)處理邏輯開(kāi)發(fā)經(jīng)驗(yàn)優(yōu)先，如高速AD/DA、Aurora、萬(wàn)兆以太網(wǎng)等；具有數(shù)據(jù)采集/信號(hào)處理知識(shí)和應(yīng)用經(jīng)驗(yàn)優(yōu)先，如數(shù)字中頻 DUC/DDC、數(shù)字濾波等； 3、 技能：具備較強(qiáng)的數(shù)字信號(hào)處理知識(shí)，有過(guò)大型FPGA的信號(hào)處理開(kāi)發(fā)經(jīng)驗(yàn)、FPGA高速接口設(shè)計(jì)經(jīng)驗(yàn)、高速AD/DA調(diào)試經(jīng)驗(yàn)、硬件調(diào)試經(jīng)驗(yàn)；能夠使用 matlab 進(jìn)行數(shù)字信號(hào)分析，了解 Xilinx FPGA 內(nèi)部結(jié)構(gòu)，以及常用的 IP，如 DDS、FIR、FFT、204B、Aurora、MIG等，熟悉數(shù)字信號(hào)處理技術(shù)如濾波器，F(xiàn)FT，DBF等；具有良好的溝通和團(tuán)隊(duì)合作能力。 4、 知識(shí)：具有Xilinx、國(guó)微、復(fù)旦微等公司主流FPGA器件開(kāi)發(fā)經(jīng)驗(yàn)，熟悉ZYNQ器件的開(kāi)發(fā)調(diào)試，精通FPGA軟件代碼編寫(xiě)、模塊設(shè)計(jì)、仿真，以及資源和時(shí)序優(yōu)化，具有優(yōu)良的代碼風(fēng)格和良好的編程習(xí)慣；了解 Xilinx FPGA 內(nèi)部結(jié)構(gòu)，以及常用的IP，如 DDS、FIR、FFT、204B、Aurora、MIG 等。