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工作內(nèi)容： 負責基于FPGA的軟件開發(fā)，實現(xiàn)FFT、DDC、DDS、高速數(shù)據(jù)采集、DDR3/4存儲、IQ信號分析及信號預處理等功能，完成乘加累積，DBF權系數(shù)配置，進行相控陣波束合成與控制實現(xiàn)，完成確保系統(tǒng)的高性能與穩(wěn)定性。 主要職責： 1、負責FPGA軟件需求分析，方案設計，編碼、仿真、調(diào)試、代碼優(yōu)化和維護； 2、完成相關算法的FPGA實現(xiàn)和優(yōu)化，負責FPGA的接口、算法邏輯的設計； 3、負責開發(fā)和驗證FPGA IP核，包括但不限于FFT，濾波器，數(shù)字上/下變頻，IQ信號，數(shù)據(jù)預分析處理，DDS的功能實現(xiàn)； 4、開發(fā)ADC、DAC與FPGA之間的接口和FPGA與硬盤之間軟件接口，實現(xiàn)高效的數(shù)據(jù)傳輸與處理； 5、負責時鐘、存儲、電源、復位、通信(包括光纖通信)、控制等模塊的軟件開發(fā)； 6、完成產(chǎn)品調(diào)試測試。 任職資格： 1、掌握Xilinx Zynq平臺開發(fā)的優(yōu)先； 2、有相控陣數(shù)字波束合成控制經(jīng)驗者優(yōu)先； 3、熟悉高速 ADC/DAC /FPGA的原理及其應用； 4、熟練使用 FPGA 開發(fā)工具，如 Vivado 、Quartus等；熟練掌握 VHDL 或Verilog 語言，能夠獨立完成 FPGA 邏輯設計； 5、具備良好的調(diào)試和測試能力，能夠解決復雜的技術問題； 6、具備良好的團隊協(xié)作精神和溝通能力，能夠承擔項目壓力。 工作時間： 早上：8:30-12:30 下午：13:30-17:30 公司地址：西安國家民用航天產(chǎn)業(yè)基地飛天路485號 乘車路線： 1.附近公交站點乘坐239/4-05/4-15/260至“航天管委會”站下車； 2.附近公交站點乘坐733到“神州三路口”（好快活水廠）站下車即到。 職位福利：五險一金、績效獎金、加班補助、全勤獎、包住、交通補助、餐補、定期體檢