職位描述
Cadence數(shù)字后端設計SOC EncounterICCompilerSynopsysAI芯片SOC芯片ASIC芯片電子/半導體/集成電路
base：西安、上海
崗位職責：
1、 負責模塊或頂層從Netlist到GDS2的物理實現(xiàn), 包括Floorplan, Place, CTS, Route；
2、負責模塊或頂層的IR/EM分析，DRC/LVS/ESD等；
3、負責模塊或頂層的時序收斂，形式驗證，低功耗檢查，功耗分析等;
4、協(xié)助完成前后端數(shù)據(jù)交付檢查；
5、具備常見問題的分析與解決能力；
6、具備先進工藝的后端流程開發(fā)和優(yōu)化者優(yōu)先；
7、具備良好的英語讀寫能力，良好的溝通能力和團隊合作精神；
任職要求：
1、本科及以上學歷，微電子學／集成電路/計算機／電子工程／通信工程等相關(guān)專業(yè)；
2、3年以上的芯片數(shù)字后端設計項目經(jīng)驗（必要條件）
3、熟悉 P&R后端工具5/7/12/22/28 nm工藝節(jié)點，完成過相關(guān)工藝的流片；
4、熟練使用Cadence/Synopsys的P&R工具，STA/PV signoff 工具；
5、具備模塊級或全芯片級從Netlist到GDS2的整個后端流程Tapout經(jīng)驗（Floorplaning, Power，Planning, Placement & Optimization, CTS，Routing，ECO，RC/Spef，STA）；
6、熟悉STA靜態(tài)時序分析及低功耗設計與分析；
7、具備大規(guī)模復雜SOC芯片后端設計經(jīng)驗；做過cpu/ddr等模塊優(yōu)先考慮；
8、熟練使用Tcl/Perl/Shell等常用腳本語言；工作地點
浦東新區(qū)上海張江高科技園區(qū)
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