職位描述
Verilog HDL電子/半導體/集成電路儀器儀表制造工業(yè)自動化
崗位職責：
1.根據(jù)系統(tǒng)需求進行方案設(shè)計，可行性驗證，芯片選型等工作；
2.配合硬件人員完成FPGA部分原理圖設(shè)計與審核；
3.進行FPGA系統(tǒng)開發(fā)，調(diào)試，功能實現(xiàn)。
任職要求：
1.微電子/電子信息/通信工程相關(guān)專業(yè)，本科以上學歷，1-3年FPGA開發(fā)設(shè)計經(jīng)驗；
2.具有扎實的數(shù)字電路和模擬電路功底，熟悉Ethernet（TCP/IP，UDP），SPI，I2C，UART，USB，CAN等常用數(shù)字接口；
3.至少熟悉Altera/Xilinx/Lattice等其中一種FPGA器件的開發(fā)流程，至少使用過一款FPGA器件做過完整的產(chǎn)品開發(fā)；
4.熟練掌握Verilog語言；熟悉Quartus II或ISE、Vivado等EDA開發(fā)工具；熟練掌握Modelsim調(diào)試仿真工具的使用；
5.熟練MATLAB編程與算法仿真，掌握C語言，并能根據(jù)項目需求在FPGA上實現(xiàn)C語言描述的算法；
6.具有AD/DA的相關(guān)FPGA接口調(diào)試經(jīng)驗者優(yōu)先；具有DDR2/DDR3、PCIe、GTX等高速接口調(diào)試經(jīng)驗者優(yōu)先；
7.熟悉FPGA時序約束，仿真，調(diào)試流程。熟悉信號濾波，頻譜搬移，信號變換等功能開發(fā)；
7. 熟悉技術(shù)文檔的編寫；具備良好的文檔編制習慣和代碼書寫規(guī)范；
上班地址：廈大校區(qū)過去一點（石井聯(lián)東u谷）
工作地點
湖里區(qū)廈門市軟件園望海路-15號樓之二 504-6
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職位發(fā)布者
吳女士/HR
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