職位描述:
作為進(jìn)迭時(shí)空CPU架構(gòu)與開發(fā)團(tuán)隊(duì)的一員,你會(huì)參與面向多種應(yīng)用場(chǎng)景的自研RISC-V處理器內(nèi)核的建模、微架構(gòu)設(shè)計(jì)與實(shí)現(xiàn)。
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探索最前沿的RISC-V發(fā)展與趨勢(shì),包括RVI社區(qū)的進(jìn)展、學(xué)術(shù)和工業(yè)界的成果、客戶需求的變化與趨勢(shì),以及業(yè)界優(yōu)秀的工程實(shí)踐方法;
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研究和歸納主流應(yīng)用和benchmark程序的特性,通過建模、仿真和原型驗(yàn)證等方法分析性能瓶頸的關(guān)鍵因素,主導(dǎo)微架構(gòu)的創(chuàng)新、優(yōu)化與設(shè)計(jì);
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負(fù)責(zé)進(jìn)迭時(shí)空RISC-V處理器內(nèi)核新feature的微架構(gòu)定義和RTL設(shè)計(jì),參與從微架構(gòu)到RTL級(jí)實(shí)現(xiàn)的完整流程;
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提高進(jìn)迭時(shí)空RISC-V處理器內(nèi)核的功耗,性能和面積(PPA)指標(biāo)。
職位要求:(滿足任意一項(xiàng) )
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計(jì)算機(jī)系統(tǒng)結(jié)構(gòu),計(jì)算機(jī)、微電子專業(yè)、電路與系統(tǒng)、通信、人工智能等相關(guān)專業(yè),計(jì)算機(jī)體系結(jié)構(gòu)或微電子方向有理論基礎(chǔ)扎實(shí),具有一定工程和編碼能力,同時(shí)具備研究與創(chuàng)新能力;
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熟悉RISC-V(或Arm)通用處理器指令集與微架構(gòu),cache算法與微架構(gòu),分支預(yù)測(cè)算法與微架構(gòu)等,有相關(guān)經(jīng)驗(yàn)優(yōu)先;
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熟悉業(yè)界常用的片上互聯(lián)NoC技術(shù)和片間互聯(lián)協(xié)議,對(duì)存儲(chǔ)介質(zhì)有一定的研究,熟悉多核處理器Cache原理、結(jié)構(gòu)及數(shù)據(jù)一致性;
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熟悉Gem5或其他微架構(gòu)仿真器,有建模和仿真經(jīng)驗(yàn)者優(yōu)先;
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熟悉硬件模塊的設(shè)計(jì)(Verilog, SystemVerilog,Chisel等),有CPU或DSP處理器設(shè)計(jì)或驗(yàn)證經(jīng)驗(yàn)優(yōu)先。
備選軟技能描述:
好奇心驅(qū)動(dòng)力,良好的創(chuàng)新能力,追求工作到極致,好的團(tuán)隊(duì)協(xié)作能力。