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1. 負(fù)責(zé)設(shè)計(jì)、開(kāi)發(fā)和維護(hù)系統(tǒng)信號(hào)完整性方案，確保設(shè)計(jì)的有效性和可靠性。 2. 參與產(chǎn)品開(kāi)發(fā)過(guò)程中的設(shè)計(jì)評(píng)審，提出關(guān)于信號(hào)完整性的技術(shù)建議和改進(jìn)方案。 3. 開(kāi)發(fā)和維護(hù)信號(hào)完整性測(cè)試方法和流程，制定測(cè)試計(jì)劃并進(jìn)行測(cè)試，提供測(cè)試報(bào)告和數(shù)據(jù)分析。 4. 分析系統(tǒng)集成中的問(wèn)題，并提供解決方案，確保系統(tǒng)集成的高效運(yùn)行。 5. 持續(xù)跟蹤和研究最新的信號(hào)完整性技術(shù)和工具，提出改進(jìn)和創(chuàng)新的建議。 6. 主導(dǎo)服務(wù)器主板、背板、線纜等關(guān)鍵部件的高速信號(hào)（PCIe Gen5/6、DDR5、USB4、400G以太網(wǎng)等）全鏈路建模與仿真優(yōu)化，包括拓?fù)浣Y(jié)構(gòu)設(shè)計(jì)、阻抗匹配、損耗補(bǔ)償、串?dāng)_抑制等。 7. 搭建高速信號(hào)測(cè)試平臺(tái)（如TDR/VNA/實(shí)時(shí)示波器），執(zhí)行眼圖測(cè)試、S參數(shù)測(cè)試、誤碼率分析（BERT）等，對(duì)比仿真與實(shí)測(cè)數(shù)據(jù)并迭代優(yōu)化設(shè)計(jì)。 8. 主導(dǎo)SI相關(guān)失效分析（如振鈴、反射、ISI問(wèn)題），提供根因解決方案并推動(dòng)設(shè)計(jì)/工藝改進(jìn) 9. 跟蹤IEEE/PCI-SIG/OIF等組織技術(shù)標(biāo)準(zhǔn)演進(jìn)（如PCIe Gen6、UCIe、224G PAM4），主導(dǎo)新協(xié)議接口的SI可行性研究與技術(shù)路徑規(guī)劃。 10. 探索AI服務(wù)器/液冷系統(tǒng)等新興場(chǎng)景下的SI挑戰(zhàn)（如散熱對(duì)介電性能影響、高密度布線串?dāng)_抑制） 11. 與硬件設(shè)計(jì)、PCB Layout、結(jié)構(gòu)散熱團(tuán)隊(duì)緊密協(xié)作，推動(dòng)SI設(shè)計(jì)規(guī)則在開(kāi)發(fā)流程中的落地執(zhí)行。 12. 編制SI設(shè)計(jì)指南、測(cè)試報(bào)告等技術(shù)文檔，建立企業(yè)級(jí)SI知識(shí)庫(kù)并主導(dǎo)內(nèi)部技術(shù)培訓(xùn)。 任職資格 1. 本科及以上學(xué)歷，電子工程、通信工程、物理學(xué)或相關(guān)專(zhuān)業(yè)。 2. 熟練掌握信號(hào)完整性分析工具和仿真軟件，如SPICE、IBIS、S-parameter等。 3. 有相關(guān)的服務(wù)器主板測(cè)試和分析經(jīng)驗(yàn)。 4. 熟悉PCB設(shè)計(jì)流程和工具，具備一定的PCB設(shè)計(jì)經(jīng)驗(yàn)，熟悉信號(hào)完整性布線和布局技術(shù)。 5. 具備較強(qiáng)的解決問(wèn)題能力和創(chuàng)新思維，能夠獨(dú)立思考和解決復(fù)雜的信號(hào)完整性問(wèn)題。 6. 具備良好的溝通和協(xié)調(diào)能力，能夠與多個(gè)團(tuán)隊(duì)和部門(mén)進(jìn)行有效的合作和協(xié)作。 7. 熟悉高速測(cè)試設(shè)備（≥33GHz示波器、VNA、TDR）操作與信號(hào)去嵌入（De-embedding）技術(shù)； 8. 熟悉服務(wù)器/數(shù)據(jù)中心硬件架構(gòu)，了解高速背板設(shè)計(jì)、電源完整性（PI）協(xié)同優(yōu)化方法。 9. 5年以上高速數(shù)字電路SI/PI設(shè)計(jì)經(jīng)驗(yàn)，至少主導(dǎo)過(guò)2代PCIe（Gen4及以上）或DDR（DDR4及以上）完整項(xiàng)目開(kāi)發(fā)。