職位描述
FPGA芯片微處理器接口芯片
崗位職責
1、精通高速SerDes Pre-Emphasis、Equalizer電路架構及原理
2、了解高速SerDes CML驅動電路和接收電路實現(xiàn)原理
3、了解高速SerDes PISO、SIPO電路實現(xiàn)原理
4、熟悉PLL VCO電路架構及原理（RO Or LC VCO），熟悉Oscillator頻率調整 方法及實現(xiàn)
5、了解Clock Tree電路架構
6、了解DSP乘法器電路架構及原理
7、精通PCIe協(xié)議
8、精通DDR Timing，完成Verilog讀寫驅動開發(fā)
9、精通JTAG協(xié)議及Timing，完成Verilog 協(xié)議時序開發(fā)
10、對多電平標準IO電路架構及原理有深入的了解
11、用Verilog開發(fā)以上電路模塊測試用例及仿真
12、參與或負責芯片測試方案編寫，數(shù)據(jù)分析、失效分析
13、對FPGA芯片測試新方法、新工具等進行研究、引進和優(yōu)化
任職要求
1）微電子、電子工程、集成電路、通信、自動化及相關專業(yè)；
2）有芯片驗證或者FPGA開發(fā)工作經驗者優(yōu)先；
3）熟悉FPGA板級開發(fā)驗證、調試手段和方法，有調板經驗者優(yōu)先；
4）熟悉FPGA高速IO接口，具有設計或驗證經驗者優(yōu)先，包括 SerDes、DDR、 PCIe等；
5）熟練掌握FPGA開發(fā)流程，VIVADO集成開發(fā)環(huán)境，Modelsim仿真軟件；
6）熟練使用萬用表、數(shù)字源表、高速示波器、函數(shù)發(fā)生器、邏輯分析儀等測量工具；
工作地點
濟南歷城區(qū)人工智能大廈28層
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職位發(fā)布者
張先生/FPGA芯片測試開發(fā)主管
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山東芯慧微電子科技有限公司山東芯慧微電子科技有限公司，創(chuàng)立于2019年7月，創(chuàng)業(yè)團隊來自于中科院電子所可編程芯片與系統(tǒng)研究室。公司堅持用戶導向、創(chuàng)新驅動，秉承中科院“解決國家戰(zhàn)略和經濟社會發(fā)展重大科技問題”的使命。瞄準航天、軍工、信息安全、工業(yè)控制、通信等行業(yè)需求，研制自主可控的大規(guī)模、高可靠FPGA芯片產品。面向人工智能、數(shù)據(jù)中心等新興產業(yè)需求，研發(fā)新型可編程深度學習神經網(wǎng)絡陣列FPNA芯片。針對關鍵專用芯片國產化替代需求，研發(fā)時鐘芯片和紅外焦平面讀出電路芯片，同時，提供高性能集成電路設計服務。
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