職位描述
PLL模塊CMOS工藝
崗位職責：
1.建模，電路設計，電路前仿真，后仿真;
2.指導版圖設計工程師完成高質量的版圖設計;
3.根據(jù)設計結果完成設計文檔和測試計劃;
4.對芯片功能模塊進行系統(tǒng)測試、并對其性能進行評估和問題分析;
5.協(xié)助產(chǎn)品工程師，達到生產(chǎn)制造要求;
6.協(xié)助應用工程師，達到客戶要求;
7.細化說明書，支持內部、外部用戶，如應用工程師等。
任職要求:
1.碩士及其以上學歷，集成電路、微電子及相關專業(yè)；
2.兩年年及以上射頻及模擬集成電路設計經(jīng)驗；
3.扎實的MOS制程、器件物理及建模知識;
4.CMOS射頻模擬電路設計經(jīng)驗，至少會做以下其中一個電路:如LNA, MIXER，PA, PLL，VCO等;
5.有以下經(jīng)驗優(yōu)先:藍牙收發(fā)器，Zigbee收發(fā)器，精通2.4GHz收發(fā)器，subGhz 收發(fā)機、WIFI收發(fā)器;
6.熟悉版圖設計，驗證(DRC.LVS，PEX),指導版圖人員進行布局；
7.具備團隊合作精神，工作敬業(yè)負責。
職位福利：五險一金、績效獎金、年底13薪、項目獎勵、周末雙休、帶薪年假、定期體檢、定期團建、節(jié)日福利、生日福利。
職位亮點：定期技術交流與培訓、芯片設計行業(yè)前沿職位。
工作地點
菱湖大道111號江蘇省無錫市新吳區(qū)菱湖大道111號國家軟件園天鵝座C座18樓
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江蘇珞珈聚芯集成電路設計有限公司江蘇集萃智能集成電路設計技術研究所有限公司是江蘇省產(chǎn)業(yè)技術研究院下屬的由無錫高新區(qū)與集成電路領域***專家團隊共建的研究所。研究所將圍繞著集成電路設計核心技術的研發(fā)，集成電路設計優(yōu)秀團隊的引入和孵化，以及依靠資本力量扶持優(yōu)秀集成電路領域創(chuàng)新企業(yè)等三個方面，開展高效的市場化運作;同時研究所還建設了集成電路產(chǎn)業(yè)服務平臺，提供設計工具，測試，流片等一整套產(chǎn)業(yè)化服務。研究所期盼在集成電路領域擁有豐富成功經(jīng)驗的優(yōu)秀人才的加入，共同為我國集成電路產(chǎn)業(yè)振興，增強我國在集成電路領域的國際競爭力做出應有的貢獻。
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