職位描述
Verilog HDLVHDLSystem Verilog電子/半導(dǎo)體/集成電路
崗位職責(zé)：
1. 組織/參與FPGA軟件第三方測(cè)試項(xiàng)目；
2. 組織/參與項(xiàng)目全流程工作，包括測(cè)試需求分析、測(cè)試策劃、測(cè)試用例設(shè)計(jì)、測(cè)試執(zhí)行和測(cè)試總結(jié)工作；
3. 主要進(jìn)行FPGA軟件代碼審查、功能仿真、靜態(tài)時(shí)序分析等相關(guān)測(cè)試工作, 對(duì)測(cè)試中發(fā)現(xiàn)的問(wèn)題進(jìn)行及時(shí)跟蹤、反饋，重現(xiàn)，與開(kāi)發(fā)協(xié)同解決問(wèn)題；
4. 參與FPGA軟件測(cè)試技術(shù)研究，進(jìn)行技術(shù)交流、總結(jié)，發(fā)表技術(shù)性文章等。
任職要求：
1. 具有碩士學(xué)歷，電子信息類、微電子學(xué)、集成電路、應(yīng)用物理學(xué)、計(jì)算機(jī)類、自動(dòng)化類等相關(guān)專業(yè)；黨員優(yōu)先。
2. 熟悉VHDL/Verilog語(yǔ)言、了解System Verilog語(yǔ)言，熟悉規(guī)則檢查、功能仿真、門級(jí)仿真、時(shí)序仿真、靜態(tài)時(shí)序分析、邏輯等效性分析、跨時(shí)鐘域分析優(yōu)先；
3. 熟練Vivado、ISE、Quartus II等常用的EDA工具，Model Sim和Questa Sim等仿真測(cè)試工具，HDL Designer等規(guī)則檢查工具；
4. 具有清晰的邏輯思維，較強(qiáng)的學(xué)習(xí)鉆研能力；
5. 具有較強(qiáng)的團(tuán)隊(duì)合作精神，責(zé)任心強(qiáng)；
6. 具有較強(qiáng)的承壓能力；
7. 能夠適應(yīng)短期出差。
工作地點(diǎn)
西安雁塔區(qū)財(cái)富中心二期-B座
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職位發(fā)布者
王仲康/hr
三日內(nèi)活躍立即溝通
北京賽迪軟件測(cè)評(píng)工程技術(shù)中心有限公司中國(guó)軟件評(píng)測(cè)中心（以下簡(jiǎn)稱“中國(guó)評(píng)測(cè)”）成立于1990年，是工業(yè)和信息化部直屬的國(guó)家一級(jí)科研事業(yè)單位。在測(cè)試領(lǐng)域，中國(guó)評(píng)測(cè)首家獲得中國(guó)實(shí)驗(yàn)室國(guó)家認(rèn)可委員會(huì)實(shí)驗(yàn)室認(rèn)可資質(zhì)，迄今已完成萬(wàn)余款軟硬件產(chǎn)品和數(shù)千項(xiàng)信息系統(tǒng)工程項(xiàng)目測(cè)試，是國(guó)內(nèi)最具權(quán)威性的國(guó)家級(jí)軟硬件產(chǎn)品和信息系統(tǒng)測(cè)試實(shí)驗(yàn)室。在認(rèn)證領(lǐng)域，早在1999年即獲得原信息產(chǎn)業(yè)部授權(quán)，開(kāi)展計(jì)算機(jī)信息系統(tǒng)集成資質(zhì)認(rèn)證，2003年開(kāi)展雙模型認(rèn)證服務(wù)，是國(guó)內(nèi)最早開(kāi)展認(rèn)證服務(wù)的權(quán)威機(jī)構(gòu)。在監(jiān)理領(lǐng)域，中國(guó)評(píng)測(cè)是首家信息系統(tǒng)工程監(jiān)理試點(diǎn)單位并首批獲得信息系統(tǒng)工程監(jiān)理部級(jí)資質(zhì)。在國(guó)家重大電子政務(wù)工程中，已承擔(dān)“一網(wǎng)、一站、一庫(kù)、九金工程”項(xiàng)目監(jiān)理，成為業(yè)界領(lǐng)軍企業(yè)。在評(píng)估領(lǐng)域，率先研究制定政府網(wǎng)站績(jī)效評(píng)估指標(biāo)體系，并連續(xù)8年開(kāi)展中國(guó)政府網(wǎng)站績(jī)效評(píng)估工作。
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