職位描述
Verilog HDLSystem Verilog電子設(shè)備制造計(jì)算機(jī)硬件電子/半導(dǎo)體/集成電路
【崗位職責(zé)】：
1. 負(fù)責(zé)通信、雷達(dá)或圖像處理系統(tǒng)中中FPGA算法、接口邏輯設(shè)計(jì)；
2. FPGA相關(guān)設(shè)計(jì)的仿真、調(diào)試及測(cè)試驗(yàn)證；
3. 參與系統(tǒng)聯(lián)試，分析、定位及解決聯(lián)試過(guò)程中出現(xiàn)的問(wèn)題；
4. 負(fù)責(zé)相關(guān)技術(shù)文檔編制，參與技術(shù)討論與交流。
【任職要求】：
1. 通信、電子、微電子、計(jì)算機(jī)相關(guān)專(zhuān)業(yè)，本科3年/碩士2年以上工作經(jīng)歷；
2. 熟練掌握verilog/system verilog等硬件描述語(yǔ)言；
3. 熟悉主流的FPGA芯片及其開(kāi)發(fā)軟件，具有Xilinx系列芯片開(kāi)發(fā)經(jīng)驗(yàn)；
4. 熟悉PCIE/SRIO/DDR等其中一種高速I(mǎi)P工作過(guò)程的優(yōu)先；
5. 態(tài)度認(rèn)真負(fù)責(zé)，具備良好的團(tuán)隊(duì)合作和協(xié)調(diào)溝通能力。
工作地點(diǎn)
合肥蜀山區(qū)中安創(chuàng)谷B4棟
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