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崗位職責(zé)： 1、負(fù)責(zé)設(shè)備FPGA軟件設(shè)計、仿真和系統(tǒng)測試工作(RTL級)； 2、負(fù)責(zé)圖像信息采集傳輸、圖像降噪處理等工作； 3、與算法工程師合作，完成相關(guān)算法的FPGA代碼移植； 4、編寫項目開發(fā)文檔及調(diào)試記錄。 5、板級系統(tǒng)性驗證、關(guān)鍵 IP 的設(shè)計審核 任職要求： 1、本科及以上學(xué)歷，通信、電子工程、自動化等相關(guān)專業(yè)，從事相關(guān)工作5年以上； 2、熟練掌握Verilog語言，熟悉XILINIX FPGA或 ALTER FPGA內(nèi)部結(jié)構(gòu)，具有3年以上FPGA產(chǎn)品開發(fā)經(jīng)驗； 3、熟悉常用總線協(xié)議，如：I2C、PCIe、SPI、MDIO等，有FPGA調(diào)試經(jīng)驗和硬件電路調(diào)試經(jīng)驗，掌握常用儀器儀表的使用方法；具備CAN總線、DDR2、SRAM、FLASH等各類存儲器讀寫和高速數(shù)傳相關(guān)經(jīng)驗者優(yōu)先； 4、熟悉以太網(wǎng)協(xié)議、SDH、OTN等常用傳輸協(xié)議中的一種或多種； 5、具有良好的數(shù)字電路基礎(chǔ)、良好的Verilog，HDL代碼風(fēng)格，熟練使用仿真、綜合、時序分析工具； 6、能讀懂VHDL邏輯。 7、可獨立閱讀相關(guān)器件英語材料； 8、有圖像處理或圖像識別 FPGA 開發(fā)經(jīng)驗、有較多復(fù)雜工程整合和時序分析經(jīng)驗，有 RTL 代碼測試經(jīng)驗。 9、強(qiáng)烈的需求和目標(biāo)導(dǎo)向性，團(tuán)隊通力合作意識。