職位描述
Verilog HDLVHDL電子/半導(dǎo)體/集成電路計(jì)算機(jī)硬件
職位描述：
1-具備FPGA完整知識(shí)體系結(jié)構(gòu)，有自己獨(dú)特的芯片行業(yè)職業(yè)發(fā)展路徑；
2-具備FPGA相關(guān)開(kāi)發(fā)工作10年以上工作經(jīng)驗(yàn)；
3-參與并主導(dǎo)過(guò)5項(xiàng)（不低于）以FPGA作為產(chǎn)品核心解決方案的項(xiàng)目開(kāi)發(fā)，經(jīng)歷過(guò)FPGA作為產(chǎn)品核心器件且產(chǎn)品化落地的全流程工作；
4-熟悉Xilinx/Altera相關(guān)FPGA產(chǎn)品的特性，并具備與FPGA原廠工程師進(jìn)行順暢溝通的人脈關(guān)系與渠道；
5-具備FPGA架構(gòu)設(shè)計(jì)、模塊劃分、功能開(kāi)發(fā)、功能調(diào)試、產(chǎn)品化等全棧特性者優(yōu)先；
6-熟練使用FPGA全流程開(kāi)發(fā)工具，包括不限于：vivado、VCS、verdi、synplify、spyglass等開(kāi)發(fā)工具；
7-熟悉FPGA內(nèi)部資源特性及資源分布情況，具備FPGA選型的技能；
8-掌握數(shù)字信號(hào)處理相關(guān)知識(shí)：DDC、DUC、FFT、FIR；
9-掌握高速接口10GMAC、SRIO、PCIE、JEDS204B、DDR3/DDR4、HBM接口功能開(kāi)發(fā)調(diào)試技能；
10-帶過(guò)FPGAK開(kāi)發(fā)組經(jīng)驗(yàn)優(yōu)先；
任職條件：
1-985/211本科及以上學(xué)歷，計(jì)算機(jī)、電子、通信及相關(guān)專業(yè)畢業(yè)；
2-8年以上數(shù)字電路設(shè)計(jì)經(jīng)驗(yàn)，有主持或參與大型ASIC或FPGA項(xiàng)目經(jīng)歷；
3-精通Verilog語(yǔ)言，精通FPGA / ASIC前端設(shè)計(jì)開(kāi)發(fā)工具；
4-熟悉FPGA器件結(jié)構(gòu)和特性，或ASIC后端和工藝領(lǐng)域知識(shí)；
5-有網(wǎng)絡(luò)或者存儲(chǔ)業(yè)務(wù)領(lǐng)域FPGA / ASIC設(shè)計(jì)開(kāi)發(fā)經(jīng)驗(yàn)，擁有PCIe，以太接口，DDR，查找算法，RISC CPU SoC集成等專項(xiàng)技能者優(yōu)先；
工作地點(diǎn)
無(wú)錫新吳區(qū)東莊電力電子科技園
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蔡女士/HR
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深存科技(無(wú)錫)有限公司深存科技StorageX自2020年成立以來(lái)，一直致力于“以數(shù)據(jù)為核心計(jì)算”的方向，探索算力架構(gòu)革新，解決通用人工智能和未來(lái)數(shù)據(jù)場(chǎng)景的挑戰(zhàn)。其系列化的XPU產(chǎn)品覆蓋AI、數(shù)據(jù)加速、及集群互聯(lián)能力，支持通用算法場(chǎng)景，可用于高性能AI計(jì)算、數(shù)據(jù)加速、互聯(lián)及存儲(chǔ)加速等廣泛用途，為大模型AI和海量數(shù)據(jù)處理任務(wù)提供芯片/硬件技術(shù)基礎(chǔ)。此次能夠進(jìn)入重點(diǎn)備案主體名單，得益于公司過(guò)去在發(fā)明專利申請(qǐng)質(zhì)量、預(yù)審質(zhì)量、授權(quán)量等方面的優(yōu)異成績(jī)。此外，深存科技內(nèi)部還建立了完善的專利申請(qǐng)篩選機(jī)制，確保只有最具創(chuàng)新性和商業(yè)價(jià)值的專利技術(shù)才能通過(guò)內(nèi)部預(yù)審并最終遞交申請(qǐng)。
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