職位描述
Verilog HDLVHDLC語言計算機硬件通信/網(wǎng)絡(luò)設(shè)備電子/半導(dǎo)體/集成電路
【工作內(nèi)容】
- 負責(zé)FPGA系統(tǒng)架構(gòu)設(shè)計與實現(xiàn)，包括但不限于模塊劃分、時序分析及性能優(yōu)化。
- 根據(jù)項目需求進行FPGA固件開發(fā)，包括代碼編寫、仿真驗證、時序收斂等工作。
- 配合軟硬件團隊進行系統(tǒng)集成測試，解決開發(fā)過程中遇到的技術(shù)難題。
- 完成相關(guān)技術(shù)文檔的編寫，確保項目文檔的完整性和準(zhǔn)確性。
- 參與技術(shù)評審會議，提供專業(yè)意見以提升產(chǎn)品競爭力。
- 關(guān)注行業(yè)動態(tài)和技術(shù)發(fā)展趨勢，不斷探索新技術(shù)，提升團隊技術(shù)水平。
【任職要求】
- 本科及以上學(xué)歷，計算機、網(wǎng)絡(luò)工程、電子信息、通信工程、自動化或相關(guān)專業(yè)背景。具有微波通信或衛(wèi)星通信行業(yè)經(jīng)驗優(yōu)先。
- 25-35歲，具備3年以上FPGA開發(fā)工作經(jīng)驗。
- 熟練掌握Verilog或VHDL硬件描述語言，具備良好的編程習(xí)慣。
- 熟悉Xilinx或Altera系列FPGA芯片，了解其開發(fā)流程和工具鏈。
- 具備扎實的數(shù)字電路基礎(chǔ)，能夠獨立完成模塊級的設(shè)計與驗證。
- 具備良好的問題解決能力和團隊協(xié)作精神，能夠適應(yīng)快節(jié)奏的工作環(huán)境。
- 英語讀寫能力良好，能夠閱讀英文技術(shù)文檔。
【薪資待遇】
- 月薪12k-20k，14薪，五險一金，員工旅游，定期體檢
- 彈性工作，周末雙休。
工作地點
武侯區(qū)成都鏈訊信息技術(shù)有限公司
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職位發(fā)布者
姜彬/人事經(jīng)理
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成都鏈訊信息技術(shù)有限公司
成都鏈訊信息技術(shù)有限公司成立于2019年2月，是一家專業(yè)從事衛(wèi)星通信領(lǐng)域中地面設(shè)備的研發(fā)、生產(chǎn)、銷售和售后服務(wù)的高新技術(shù)企業(yè)，主要服務(wù)于各衛(wèi)星天線廠家、科研院所、衛(wèi)星通信集成廠家。目前主營業(yè)務(wù)涉及衛(wèi)星通信系統(tǒng)及室內(nèi)終端設(shè)備、關(guān)鍵模塊研制及配套技術(shù)支持。2019年成立以來，公司專注于衛(wèi)星通信領(lǐng)域，立志成為客戶依賴的衛(wèi)星通信解決方案專家！公司秉承“勇于創(chuàng)新、精益求精、誠信協(xié)作、客戶滿意、共同成長”的宗旨，將衛(wèi)星通信的前瞻技術(shù)研究與應(yīng)用相結(jié)合，以滿足客戶需要為目標(biāo)，以掌握核心高新技術(shù)為基礎(chǔ)，為國家和行業(yè)提供先進的通信產(chǎn)品、專業(yè)的系統(tǒng)解決方案和全方位的售后服務(wù)。公司擁有一支具有十多年衛(wèi)星通信領(lǐng)域產(chǎn)品研發(fā)經(jīng)驗的技術(shù)團隊，并在寬帶衛(wèi)通系統(tǒng)體制制定、調(diào)制解調(diào)、編解碼、快速捕獲和跟蹤等基帶信號處理方面具備多年的技術(shù)積累，掌握從協(xié)議設(shè)計到終端研制的核心技術(shù)；同時參與或自主設(shè)計多個寬帶衛(wèi)通系統(tǒng)，并承擔(dān)多個行業(yè)不同用戶衛(wèi)通系統(tǒng)項目建設(shè)，積累大量應(yīng)用及工程經(jīng)驗。
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