職位描述
VerilogVHDLC++計(jì)算機(jī)軟件船舶/航空/航天/火車制造
崗位職責(zé):
1、組織/參與FPGA軟件第三方測(cè)試項(xiàng)目全流程工作，包括測(cè)試需求分析、測(cè)試策劃、測(cè)試用例設(shè)計(jì)、測(cè)試執(zhí)行和測(cè)試總結(jié)工作；
2、主要進(jìn)行FPGA軟件代碼審查、功能仿真、靜態(tài)時(shí)序分析等相關(guān)測(cè)試工作，對(duì)測(cè)試中發(fā)現(xiàn)的問題進(jìn)行及時(shí)跟蹤反饋、重現(xiàn)，與開發(fā)協(xié)同解決問題；
3、參與FPGA軟件測(cè)試技術(shù)研究，進(jìn)行技術(shù)交流、總結(jié)。
任職要求:
1、本科以上學(xué)歷，計(jì)算機(jī)/電子/電信/通信相關(guān)專業(yè)，2~3年FPGA工作經(jīng)驗(yàn)；
2、熟悉Verilog、VHDL語言；
3、掌握FPGA設(shè)計(jì)驗(yàn)證相關(guān)工具的使用，如Vivado、ISE、Quartus、VCS、ModelSim等；
4、熟悉C、C++等語言，了解嵌入式軟件測(cè)試方法及流程；
5、熟悉規(guī)則檢查、功能仿真、門級(jí)仿真、時(shí)序仿真、靜態(tài)時(shí)序分析、邏輯等效性分析、跨時(shí)鐘域分析者優(yōu)先；
6、熟悉AX1、APB總線協(xié)議，熟悉xilinx ZY NQ熟悉DDR、UART、SPI、12C、SDI接口協(xié)議者優(yōu)先；
7、具有FPGA開發(fā)或驗(yàn)證經(jīng)驗(yàn)者優(yōu)先。
工作地點(diǎn)
長安區(qū)西安國際數(shù)字科創(chuàng)產(chǎn)業(yè)園
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