職位描述
Verilog HDL通信/網(wǎng)絡(luò)設(shè)備電子/半導(dǎo)體/集成電路
崗位職責(zé)：
1、技術(shù)文檔編寫：參與相關(guān)技術(shù)文檔的編寫，包括設(shè)計(jì)文檔、測試報(bào)告等；完成FPGA設(shè)計(jì)相應(yīng)文檔的編寫；
2、系統(tǒng)開發(fā)與調(diào)試：負(fù)責(zé)FPGA邏輯系統(tǒng)的開發(fā)和調(diào)試，包括硬件設(shè)計(jì)和軟件編程；進(jìn)行FPGA邏輯系統(tǒng)的仿真和驗(yàn)證，確保系統(tǒng)的正確性和可靠性；
3、跨部門合作：與硬件工程師、軟件工程師等其他相關(guān)人員合作，完成整個系統(tǒng)的設(shè)計(jì)和測試工作；跟蹤并解決FPGA邏輯系統(tǒng)開發(fā)過程中的問題，不斷優(yōu)化和改進(jìn)設(shè)計(jì)；
4、編程、仿真、綜合和布線：負(fù)責(zé)FPGA的編程、仿真、綜合和布線；負(fù)責(zé)FPGA的調(diào)試、測試及驗(yàn)證；
5、硬件/軟件接口定義：負(fù)責(zé)完成硬件/軟件接口的定義，需求分析及管理；負(fù)責(zé)FPGA的模塊、系統(tǒng)集成。
任職要求：
1、一本及以上學(xué)歷，電子類專業(yè)；
2、3年以上FPGA設(shè)計(jì)經(jīng)驗(yàn)；精通Verilog或VHDL等硬件描述語言；
3、熟練掌握至少1種FPGA設(shè)計(jì)工具的使用方法，如ISE、Vivado、lattice等；熟練使用仿真工具，如ModelSim等來完成仿真任務(wù)，并能夠根據(jù)仿真結(jié)果對設(shè)計(jì)進(jìn)行調(diào)整和優(yōu)化；
4、掌握時序分析的方法，了解時鐘的概念，理解時鐘約束與時鐘域等；握電路分析與電路設(shè)計(jì)的基本方法，特別是對時序邏輯和同步時序電路的設(shè)計(jì)；
5、對FPGA器件有深入的了解，并了解客戶應(yīng)用中可能會遇到的問題，以便能夠及時解答；
6、具有有較強(qiáng)的責(zé)任心、良好的團(tuán)隊(duì)意識，溝通能力，敬業(yè)精神；
7、熟悉硬件的設(shè)計(jì)和性能；對硬件有基本的知識，能夠分析EMC和硬件故障。
工作地點(diǎn)
深圳南山區(qū)萬科云城8A棟37-39樓
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陳先生/招聘主管
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卡萊特云科技股份有限公司
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