職位描述
C語(yǔ)言VHDLVerilogLinuxARM開發(fā)
職位描述：
1、 從事無(wú)線通信基帶算法實(shí)現(xiàn)。
2、 采用FPGA完成中頻濾波、基帶調(diào)制解調(diào)等數(shù)字信號(hào)處理模塊的設(shè)計(jì)。
3、 采用FPGA完成ZYNQ架構(gòu)的PL和PS模塊設(shè)計(jì)。
4、 完成FPGA的概要設(shè)計(jì)、編碼、仿真驗(yàn)證和平臺(tái)測(cè)試等工作。
職位要求：
1、本科及以上學(xué)歷，電子、通信專業(yè)，2年以上大規(guī)模FPGA設(shè)計(jì)經(jīng)驗(yàn)；
2、熟悉無(wú)線通信的相關(guān)知識(shí)，具有中頻或者基帶算法開發(fā)經(jīng)驗(yàn)，掌握數(shù)字信號(hào)處理的FPGA實(shí)現(xiàn)技術(shù)；
3、熟練掌握基于FPGA的設(shè)計(jì)流程，精通verilog或者VHDL語(yǔ)言，能夠完成從系統(tǒng)要求、架構(gòu)設(shè)計(jì)到詳細(xì)設(shè)計(jì)、代碼設(shè)計(jì)、仿真驗(yàn)證等工作，熟悉ZYNQ等SOC平臺(tái)的優(yōu)先考慮；
4、良好的數(shù)字電路基礎(chǔ)，較強(qiáng)的電路設(shè)計(jì)、調(diào)試能力，熟練使用信號(hào)源、頻譜儀和示波器等常用儀器；
5、具備良好的職業(yè)道德和工作態(tài)度，服從管理，踏實(shí)謙虛勤奮，愛(ài)崗敬業(yè)負(fù)責(zé)任，肯于鉆研技術(shù)難題，具備良好的理解能力、溝通能力和團(tuán)隊(duì)合作精神；
福利待遇：
工作時(shí)間朝9晚6中午有一個(gè)半小時(shí)休息時(shí)間、周末雙休、帶薪年假、法定節(jié)假日休息、節(jié)日福利、員工旅游、五險(xiǎn)一金、年終獎(jiǎng)。
工作表現(xiàn)優(yōu)異者有績(jī)效獎(jiǎng)金。
一年兩次加薪考核,表現(xiàn)優(yōu)異者可以獲得加薪。
* 我們需要：踏實(shí)能干，有能力，謙虛奮進(jìn)，能吃苦，有團(tuán)隊(duì)精神的年輕人。如果你是，就加入我們吧！
職位福利：五險(xiǎn)一金、帶薪年假、員工旅游、節(jié)日福利、周末雙休
職位亮點(diǎn)：帶薪年假、節(jié)日福利、員工旅游、年終獎(jiǎng)
工作地點(diǎn)
上海浦東新區(qū)九洲中心二樓C-201室
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