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崗位職責(zé)：?1) 驗(yàn)證流程和驗(yàn)證方法要求進(jìn)行編碼規(guī)則檢查、功能測(cè)試、性能測(cè)試、時(shí)序測(cè)試等，并編寫相應(yīng)的輸出文檔； 2）根據(jù)規(guī)范編寫驗(yàn)證需求，制定驗(yàn)證計(jì)劃、策略和方案；?3) 負(fù)責(zé)對(duì)回歸測(cè)試進(jìn)行驗(yàn)證，并對(duì)驗(yàn)證發(fā)現(xiàn)問題修改情況進(jìn)行追蹤；?4) 負(fù)責(zé)對(duì)所參與項(xiàng)目進(jìn)行評(píng)審和歸檔工作。 任職要求： 1) 熟悉FPGA產(chǎn)品開發(fā)流程，熟練掌握Verilog/System Verilog編程語言； 2) 熟練使用ISE、Vivado、Libero、Modelsim、Questasim等FPGA開發(fā)驗(yàn)證工具； 3) 熟悉UVM系統(tǒng)級(jí)驗(yàn)證平臺(tái)的搭建、驗(yàn)證用例的開發(fā)與調(diào)試； 4) 熟悉Shell、Tcl腳本語言，具有后端時(shí)序基礎(chǔ)，熟悉靜態(tài)時(shí)序驗(yàn)證方法的優(yōu)先； 5) 通信/集成電路/電子/計(jì)算機(jī)/自動(dòng)化控制相關(guān)專業(yè)，具有通信FPGA開發(fā)或驗(yàn)證經(jīng)驗(yàn)優(yōu)先； 6) 具備較強(qiáng)的溝通及需求理解能力。 職位福利：節(jié)日福利、不加班、績效獎(jiǎng)金、年終分紅、股票期權(quán)、帶薪年假、彈性工作、員工旅游。